{"id":1060,"date":"2026-01-19T03:50:44","date_gmt":"2026-01-19T03:50:44","guid":{"rendered":"https:\/\/mchdipcb-legacy-202609.10smt.com\/?p=1060"},"modified":"2026-01-19T03:50:45","modified_gmt":"2026-01-19T03:50:45","slug":"how-do-different-pcb-stackups-affect-impedance-at-high-frequencies","status":"publish","type":"post","link":"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/how-do-different-pcb-stackups-affect-impedance-at-high-frequencies\/","title":{"rendered":"\u00bfC\u00f3mo afectan los distintos apilamientos de placas de circuito impreso a la impedancia a altas frecuencias?"},"content":{"rendered":"<div class=\"wp-block-rank-math-toc-block\" id=\"rank-math-toc\"><h2>\u00cdndice<\/h2><nav><ul><li><a href=\"#microstrip-vs-stripline-stackup-geometry-sets-the-transmission-line\">Microstrip frente a stripline: la geometr\u00eda de apilamiento determina la l\u00ednea de transmisi\u00f3n<\/a><\/li><li><a href=\"#dielectric-thickness-to-the-reference-plane-the-biggest-impedance-knob\">Espesor diel\u00e9ctrico hasta el plano de referencia: el mayor bot\u00f3n de impedancia<\/a><\/li><li><a href=\"#dielectric-constant-dk-and-dissipation-factor-df-material-choice-at-high-frequency\">Constante diel\u00e9ctrica (Dk) y factor de disipaci\u00f3n (Df): elecci\u00f3n del material a alta frecuencia<\/a><\/li><li><a href=\"#reference-planes-and-return-path-continuity-where-impedance-calculations-break\">Planos de referencia y continuidad de la v\u00eda de retorno: d\u00f3nde se rompen los c\u00e1lculos de impedancia<\/a><\/li><li><a href=\"#copper-pour-clearance-and-crosstalk-nearby-copper-pulls-impedance\">Holgura de la colada de cobre y diafon\u00eda: el cobre cercano tira de la impedancia<\/a><\/li><li><a href=\"#manufacturing-tolerances-why-controlled-impedance-needs-a-locked-stackup\">Tolerancias de fabricaci\u00f3n: por qu\u00e9 la impedancia controlada necesita un apilamiento bloqueado<\/a><\/li><li><a href=\"#stackup-choices-vs-impedance-impact-at-high-frequency\">Opciones de apilamiento frente al impacto de la impedancia a alta frecuencia<\/a><\/li><li><a href=\"#practical-high-frequency-scenarios-that-stackup-can-make-or-break\">Escenarios pr\u00e1cticos de alta frecuencia que la acumulaci\u00f3n puede hacer o deshacer<\/a><ul><li><a href=\"#rf-front-end-and-antenna-feed-impedance-matching-cpwg-via-transitions-\">Front-end de RF y alimentaci\u00f3n de antenas (adaptaci\u00f3n de impedancias, CPWG, transiciones de v\u00edas)<\/a><\/li><li><a href=\"#high-speed-digital-interfaces-serdes-usb-hdmi-ethernet-ddr-\">Interfaces digitales de alta velocidad (SERDES, USB, HDMI, Ethernet, DDR)<\/a><\/li><li><a href=\"#hdi-and-fine-pitch-bga-escape-dense-routing-coupling-yield-\">Escape de HDI y BGA de paso fino (enrutamiento denso, acoplamiento, rendimiento)<\/a><\/li><\/ul><\/li><li><a href=\"#where-this-fits-our-manufacturing-flow-b2b-prototyping-volume-assembly-\">D\u00f3nde encaja en nuestro flujo de fabricaci\u00f3n (prototipado B2B \u2192 volumen \u2192 montaje).<\/a><\/li><\/ul><\/nav><\/div>\n\n\n\n<p class=\"wp-block-paragraph\">A alta frecuencia, tu traza no es \u201cs\u00f3lo cobre\u201d. Es una l\u00ednea de transmisi\u00f3n, y el PCB&nbsp;<strong>apilar<\/strong>&nbsp;es el entorno que da forma a sus campos el\u00e9ctricos. Si la pila cambia, la impedancia tambi\u00e9n. Es entonces cuando aparecen los habituales quebraderos de cabeza: colapso del diagrama de ojo, picos aleatorios de EMI, coincidencia de RF fallida o un prototipo \u201cfunciona en el banco, muere en el recinto\u201d.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Si construyes para OEM\/ODM, EMS, casas de dise\u00f1o o equipos de hardware de nueva creaci\u00f3n, ya conoces el patr\u00f3n: el dise\u00f1o parece limpio, pero la l\u00ednea no se comporta como promet\u00eda la calculadora. El apilamiento suele ser la causa oculta.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Esta gu\u00eda recorre las principales decisiones de apilamiento que mueven la impedancia a altas frecuencias, utilizando un lenguaje de fabricaci\u00f3n real (DFM, cupones, TDR, composici\u00f3n de grabado) en lugar de hablar s\u00f3lo de teor\u00eda.<\/p>\n\n\n\n<figure class=\"wp-block-image size-full\"><img decoding=\"async\" width=\"960\" height=\"720\" src=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-3.jpg\" alt=\"\u00bfC\u00f3mo afectan los diferentes apilamientos de placas de circuito impreso a la impedancia a altas frecuencias?\" class=\"wp-image-1061\" title=\"\" srcset=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-3.jpg 960w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-3-600x450.jpg 600w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-3-300x225.jpg 300w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-3-768x576.jpg 768w\" sizes=\"(max-width: 960px) 100vw, 960px\" \/><\/figure>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"microstrip-vs-stripline-stackup-geometry-sets-the-transmission-line\">Microstrip frente a stripline: la geometr\u00eda de apilamiento determina la l\u00ednea de transmisi\u00f3n<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">Cuando eliges una capa de se\u00f1al, tambi\u00e9n est\u00e1s eligiendo el tipo de l\u00ednea de transmisi\u00f3n:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li><strong>Microstrip<\/strong>traza de la capa externa sobre un plano de referencia<\/li>\n\n\n\n<li><strong>L\u00ednea Tira<\/strong>: traza de capa interna intercalada entre planos<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Por qu\u00e9 te interesa: los campos microstrip viven en parte en el aire y en parte en el diel\u00e9ctrico. Los campos de la l\u00ednea TEM con placas se encuentran principalmente en el diel\u00e9ctrico. Esto cambia la&nbsp;<strong>constante diel\u00e9ctrica efectiva<\/strong>, que cambia&nbsp;<strong>impedancia caracter\u00edstica (Z0)<\/strong>&nbsp;y el comportamiento de propagaci\u00f3n.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><strong>Puntos d\u00e9biles en el mundo real<\/strong>equipos mueven una red de \u201c50 \u03a9\u201d de la capa superior a una capa interior tarde en el encaminamiento \u201cpara reducir la EMI\u201d. Misma anchura, mismo espaciado, distinta impedancia. Entonces, la ruta de RF necesita un giro de \u00faltima hora, o el enlace de alta velocidad empieza a reflejarse en los conectores.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Si necesitas una regla de cordura r\u00e1pida:&nbsp;<strong>no intercambie microstrip \u2194 stripline sin volver a resolver la impedancia<\/strong>&nbsp;(solucionador de campos o tabla de apilamiento de fabricaci\u00f3n). Es como cambiar la huella del conector, porque el\u00e9ctricamente lo es.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"dielectric-thickness-to-the-reference-plane-the-biggest-impedance-knob\">Espesor diel\u00e9ctrico hasta el plano de referencia: el mayor bot\u00f3n de impedancia<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">La distancia de la traza a su plano de referencia (a menudo llamado&nbsp;<strong>H<\/strong>) es una de las mayores palancas de la impedancia:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>Mayor H \u2192 acoplamiento m\u00e1s d\u00e9bil al plano \u2192\u00a0<strong>mayor impedancia<\/strong><\/li>\n\n\n\n<li>H m\u00e1s peque\u00f1o \u2192 acoplamiento m\u00e1s fuerte \u2192\u00a0<strong>menor impedancia<\/strong><\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">El apilamiento decide de H a&nbsp;<strong>selecci\u00f3n de n\u00facleo\/preg<\/strong>, El orden de las capas y si un plano se encuentra directamente debajo de la capa de se\u00f1al.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><strong>Cuando los proyectos se tuercen<\/strong>:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>Alguien elige un apilamiento \u201cest\u00e1ndar\u201d por el plazo de entrega, pero el grosor diel\u00e9ctrico bajo la capa cr\u00edtica no es el que el dise\u00f1ador supuso.<\/li>\n\n\n\n<li>O el fabricante ajusta el estilo del preimpregnado para alcanzar los objetivos de laminaci\u00f3n, y la impedancia se desv\u00eda a menos que se especifique una impedancia controlada con cupones.<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Si tu objetivo es una impedancia controlada, bloquea estos antes:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>impedancia de destino (monofocal \/ diferencial)<\/li>\n\n\n\n<li>en qu\u00e9 capa vive la red<\/li>\n\n\n\n<li>espesor diel\u00e9ctrico del objetivo respecto al plano de referencia<\/li>\n\n\n\n<li>suposiciones sobre el peso del cobre (porque el grosor afecta a la geometr\u00eda)<\/li>\n<\/ul>\n\n\n\n<figure class=\"wp-block-image size-full\"><img decoding=\"async\" width=\"960\" height=\"720\" src=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-1.jpg\" alt=\"\u00bfC\u00f3mo afectan los diferentes apilamientos de placas de circuito impreso a la impedancia a altas frecuencias?\" class=\"wp-image-1062\" title=\"\" srcset=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-1.jpg 960w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-1-600x450.jpg 600w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-1-300x225.jpg 300w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-1-768x576.jpg 768w\" sizes=\"(max-width: 960px) 100vw, 960px\" \/><\/figure>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"dielectric-constant-dk-and-dissipation-factor-df-material-choice-at-high-frequency\">Constante diel\u00e9ctrica (Dk) y factor de disipaci\u00f3n (Df): elecci\u00f3n del material a alta frecuencia<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">A frecuencias bajas, el FR-4 suele \u201cfuncionar\u201d. A frecuencias m\u00e1s altas, el material se convierte en un dial de rendimiento:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li><strong>Dk (constante diel\u00e9ctrica)<\/strong>\u00a0influye en la impedancia y el retardo de propagaci\u00f3n.<\/li>\n\n\n\n<li><strong>Df (factor de disipaci\u00f3n \/ tangente de p\u00e9rdida)<\/strong>\u00a0impulsa la p\u00e9rdida diel\u00e9ctrica, que se come el margen en canales largos.<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Dos placas pueden ser ambas de \u201c50 \u03a9\u201d y, sin embargo, una tiene una p\u00e9rdida de inserci\u00f3n notablemente mayor debido a una Df m\u00e1s alta. Por eso los equipos de RF y digitales de alta velocidad hablan de&nbsp;<strong>presupuesto de p\u00e9rdidas<\/strong>, no s\u00f3lo objetivos de impedancia.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><strong>Escenario pr\u00e1ctico<\/strong>:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>Se crea un prototipo en FR-4 y luego se pasa a un laminado de RF para la producci\u00f3n. La Dk cambia, por lo que la anchura\/espaciado anterior ya no coincide con la misma impedancia. Si no se redimensiona la geometr\u00eda, el cambio de material se convierte en una sesi\u00f3n de ajuste.<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Para los productos de se\u00f1al mixta, un compromiso com\u00fan es:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>utilizar FR-4 rentable donde sea seguro<\/li>\n\n\n\n<li>utilizar materiales de mayor rendimiento s\u00f3lo para los carriles RF \/ m\u00e1s r\u00e1pidos<\/li>\n\n\n\n<li>que las zonas de transici\u00f3n sean breves y est\u00e9n bien referenciadas<\/li>\n<\/ul>\n\n\n\n<figure class=\"wp-block-image size-full\"><img decoding=\"async\" width=\"960\" height=\"720\" src=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-2.jpg\" alt=\"\u00bfC\u00f3mo afectan los diferentes apilamientos de placas de circuito impreso a la impedancia a altas frecuencias?\" class=\"wp-image-1063\" title=\"\" srcset=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-2.jpg 960w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-2-600x450.jpg 600w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-2-300x225.jpg 300w, https:\/\/mchdipcb-legacy-202609.10smt.com\/wp-content\/uploads\/2026\/01\/How-do-different-PCB-stackups-affect-impedance-at-high-frequencies-2-768x576.jpg 768w\" sizes=\"(max-width: 960px) 100vw, 960px\" \/><\/figure>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"reference-planes-and-return-path-continuity-where-impedance-calculations-break\">Planos de referencia y continuidad de la v\u00eda de retorno: d\u00f3nde se rompen los c\u00e1lculos de impedancia<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">Los calculadores de impedancia suponen un camino de retorno limpio y continuo. La corriente de retorno de alta frecuencia entorpece la trayectoria de la se\u00f1al, principalmente bajo la traza en el plano de referencia.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Por lo tanto, las opciones de apilamiento que mejoran las v\u00edas de retorno suelen mejorar el comportamiento de la impedancia:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>planos de tierra s\u00f3lidos dedicados cerca de las capas cr\u00edticas<\/li>\n\n\n\n<li>distribuci\u00f3n plana sim\u00e9trica para reducir el alabeo y mantener estable la geometr\u00eda<\/li>\n\n\n\n<li>referencia constante para recorridos largos (evitar saltos de referencia)<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\"><strong>Modo de fallo cl\u00e1sico<\/strong>El enrutamiento a trav\u00e9s de un plano dividido, un foso o una isla de cobre aislada. La corriente de retorno se desv\u00eda. Ese desv\u00edo cambia la inductancia, creando una discontinuidad de impedancia que no has modelado.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Si vas a hacer un \"bring-up\" en un enlace de alta velocidad defectuoso, comprueba primero la historia del avi\u00f3n:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>\u00bfLa se\u00f1al hace referencia a un plano s\u00f3lido durante todo el trayecto?<\/li>\n\n\n\n<li>\u00bfLas v\u00edas de cosido mantienen la v\u00eda de retorno ajustada en las transiciones de capa?<\/li>\n\n\n\n<li>\u00bfAlguien \u201climpi\u00f3 terreno\u201d y accidentalmente abri\u00f3 un hueco bajo el carril?<\/li>\n<\/ul>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"copper-pour-clearance-and-crosstalk-nearby-copper-pulls-impedance\">Holgura de la colada de cobre y diafon\u00eda: el cobre cercano tira de la impedancia<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">El cobre alrededor de una traza de impedancia controlada no es neutro. Los vertidos de cobre, las trazas de protecci\u00f3n y las capas adyacentes pueden remodelar los campos y \u201ctirar\u201d de la impedancia.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\">Qu\u00e9 aspecto tiene en producci\u00f3n:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>Un dise\u00f1ador alcanza los 50 \u03a9 en la traza desnuda.<\/li>\n\n\n\n<li>Luego se a\u00f1ade un vertido a tierra cerca de la l\u00ednea \u201cpara apantallar\u201d.\u201d<\/li>\n\n\n\n<li>La capacitancia efectiva aumenta, la impedancia disminuye y la coincidencia se desplaza.<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Por eso los equipos de RF como&nbsp;<strong>gu\u00eda de ondas coplanar con masa (CPWG)<\/strong>&nbsp;s\u00f3lo cuando lo modelan intencionadamente. Si se a\u00f1ade cobre lateral accidentalmente, se crea una estructura similar al CPWG sin resolverlo.<\/p>\n\n\n\n<p class=\"wp-block-paragraph\"><strong>Ver tambi\u00e9n el acoplamiento<\/strong>:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>el espaciado estrecho entre pares de diferenciales modifica los equilibrios de impedancia y diafon\u00eda<\/li>\n\n\n\n<li>el enrutamiento HDI denso puede acercar demasiado a los agresores en capas adyacentes<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Cuando la densidad es alta, trate las reglas de separaci\u00f3n como restricciones el\u00e9ctricas, no como un estilo cosm\u00e9tico de dise\u00f1o.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"manufacturing-tolerances-why-controlled-impedance-needs-a-locked-stackup\">Tolerancias de fabricaci\u00f3n: por qu\u00e9 la impedancia controlada necesita un apilamiento bloqueado<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">Incluso un dise\u00f1o perfecto resuelto en campo puede desviarse en la f\u00e1brica real porque la impedancia depende de variables que se mueven:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>variaci\u00f3n de la anchura del grabado (sobregrabado\/subgrabado)<\/li>\n\n\n\n<li>variaci\u00f3n del espesor diel\u00e9ctrico (flujo del preimpregnado, estilo del vidrio)<\/li>\n\n\n\n<li>variaci\u00f3n del espesor del cobre (chapado, l\u00e1mina, pila de acabado superficial)<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Es por eso que las construcciones serias de impedancia controlada utilizan:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li><strong>cupones de impedancia<\/strong><\/li>\n\n\n\n<li><strong>Validaci\u00f3n TDR<\/strong><\/li>\n\n\n\n<li><strong>compensaci\u00f3n de grabado<\/strong><\/li>\n\n\n\n<li>indicaciones claras sobre la tolerancia de impedancia y las redes controladas<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\"><strong>Traducci\u00f3n<\/strong>Si necesita una impedancia predecible a alta frecuencia, no se limite a \u201c50 \u03a9\u201d. Especifique el m\u00e9todo de control y deje que el fabricante ajuste el proceso dentro de su margen de tolerancia.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"stackup-choices-vs-impedance-impact-at-high-frequency\">Opciones de apilamiento frente al impacto de la impedancia a alta frecuencia<\/h2>\n\n\n\n<figure class=\"wp-block-table\"><table class=\"has-fixed-layout\"><thead><tr><th>Elecci\u00f3n de pila (palabra clave)<\/th><th>Qu\u00e9 cambios en el comportamiento de la impedancia<\/th><th>Lo que ver\u00e1 en el banquillo<\/th><th>Qu\u00e9 hacer en DFM \/ fab notes<\/th><\/tr><\/thead><tbody><tr><td>Microstrip vs stripline<\/td><td>Diferente entorno de campo \u2192 diferente Z0 y velocidad.<\/td><td>RF match shifts, diff pair skew surprises<\/td><td>Bloquear asignaci\u00f3n de capas; volver a resolver al mover capas<\/td><\/tr><tr><td>Espesor diel\u00e9ctrico (H)<\/td><td>H desplaza Z0 fuertemente<\/td><td>Reflejos en los conectores, p\u00e9rdida del margen ocular<\/td><td>Especificar el objetivo H; aprobar una pila de fabricaci\u00f3n<\/td><\/tr><tr><td>Selecci\u00f3n de materiales Dk \/ Df<\/td><td>Dk afecta a la geometr\u00eda; Df afecta a la p\u00e9rdida<\/td><td>M\u00e1s atenuaci\u00f3n, menos margen, bordes ruidosos<\/td><td>Familia de materiales del Estado; alinear con el presupuesto de p\u00e9rdidas<\/td><\/tr><tr><td>Continuidad de los planos de referencia<\/td><td>Los desv\u00edos del camino de vuelta crean discontinuidades<\/td><td>Picos de EMI, errores aleatorios de enlace<\/td><td>Evite las divisiones de planos; a\u00f1ada v\u00edas de costura<\/td><\/tr><tr><td>Holgura de colada de cobre<\/td><td>El cobre cercano aumenta el acoplamiento y reduce Z0<\/td><td>\u201cFunciona hasta que se a\u00f1ade el vertido\u201d fallos<\/td><td>Mantenga la distancia o el modelo CPWG intencionadamente<\/td><\/tr><tr><td>Tolerancias + etch comp<\/td><td>La geometr\u00eda real difiere de la nominal<\/td><td>Variaci\u00f3n entre lotes, problemas de rendimiento<\/td><td>Utilizar cupones + TDR; permitir un ajuste fabuloso<\/td><\/tr><\/tbody><\/table><\/figure>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"practical-high-frequency-scenarios-that-stackup-can-make-or-break\">Escenarios pr\u00e1cticos de alta frecuencia que la acumulaci\u00f3n puede hacer o deshacer<\/h2>\n\n\n\n<h3 class=\"wp-block-heading\" id=\"rf-front-end-and-antenna-feed-impedance-matching-cpwg-via-transitions-\">Front-end de RF y alimentaci\u00f3n de antenas (adaptaci\u00f3n de impedancias, CPWG, transiciones de v\u00edas)<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">Las trazas de RF no perdonan la deriva de apilamiento. Un peque\u00f1o cambio de impedancia puede desplazar su coincidencia, lo que se manifiesta en una p\u00e9rdida de alcance, una ca\u00edda de la sensibilidad o un comportamiento inestable del PA. En las construcciones de RF, los equipos a menudo:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>mantener la topolog\u00eda de la l\u00ednea de alimentaci\u00f3n coherente (microstrip o CPWG)<\/li>\n\n\n\n<li>planos de referencia de control<\/li>\n\n\n\n<li>minimizar los intercambios de capas y las v\u00edas secundarias<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Si est\u00e1 construyendo prototipos de RF o placas de alta frecuencia, merece la pena alinear el apilamiento y el control de impedancia desde el principio mediante un&nbsp;<strong>PCB de alta frecuencia<\/strong>&nbsp;flujo de trabajo, no como un parche de \u00faltima etapa. Puede dirigir a los lectores a sus p\u00e1ginas de capacidades de RF y alta frecuencia para esta ruta (v\u00e9anse los enlaces m\u00e1s abajo).<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" id=\"high-speed-digital-interfaces-serdes-usb-hdmi-ethernet-ddr-\">Interfaces digitales de alta velocidad (SERDES, USB, HDMI, Ethernet, DDR)<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">Los equipos digitales a veces subestiman lo r\u00e1pido que los bordes \u201cact\u00faan RF\u201d. Las decisiones de apilamiento que mantienen estable la impedancia tambi\u00e9n reducen la EMI y simplifican la conformidad:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>planos de referencia s\u00f3lidos<\/li>\n\n\n\n<li>uso coherente de las capas en los carriles cr\u00edticos<\/li>\n\n\n\n<li>transiciones de capa cortas y bien cosidas<\/li>\n\n\n\n<li>geometr\u00eda de pares controlada con restricciones claras<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Si su producto final incluye el montaje, los problemas de integridad de la se\u00f1al pueden convertirse en costosos bucles de reprocesamiento. Por eso, muchos equipos OEM y EMS prefieren combinar la fabricaci\u00f3n de impedancia controlada con el flujo de fabricaci\u00f3n llave en mano.<\/p>\n\n\n\n<h3 class=\"wp-block-heading\" id=\"hdi-and-fine-pitch-bga-escape-dense-routing-coupling-yield-\">Escape de HDI y BGA de paso fino (enrutamiento denso, acoplamiento, rendimiento)<\/h3>\n\n\n\n<p class=\"wp-block-paragraph\">Los apilamientos de IDH exprimen la geometr\u00eda. Esto aumenta la sensibilidad a las variaciones del proceso y el acoplamiento. El truco est\u00e1 en el equilibrio:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>densidad de enrutamiento frente a estabilidad de impedancia<\/li>\n\n\n\n<li>v\u00eda estrategia vs stubs<\/li>\n\n\n\n<li>colocaci\u00f3n de planos frente a ruta de escape<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">En la pr\u00e1ctica, esto se soluciona tratando el apilamiento como un objeto de dise\u00f1o de primera clase, no como una tabla que se elige al final.<\/p>\n\n\n\n<h2 class=\"wp-block-heading\" id=\"where-this-fits-our-manufacturing-flow-b2b-prototyping-volume-assembly-\">D\u00f3nde encaja en nuestro flujo de fabricaci\u00f3n (prototipado B2B \u2192 volumen \u2192 montaje).<\/h2>\n\n\n\n<p class=\"wp-block-paragraph\">Si se abastece en una f\u00e1brica de PCB B2B con sede en China, la forma m\u00e1s r\u00e1pida de reducir el riesgo es sencilla:<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>decidir el apilamiento con antelaci\u00f3n<\/li>\n\n\n\n<li>indicar claramente la impedancia controlada<\/li>\n\n\n\n<li>deje que DFM + cup\u00f3n\/TDR cierren el bucle antes de escalar<\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Si desea alinear el art\u00edculo con la estructura de su sitio, aqu\u00ed tiene p\u00e1ginas internas que coinciden con el recorrido t\u00edpico del comprador y los temas t\u00e9cnicos anteriores (todos los enlaces extra\u00eddos de su lista PCB.json).<\/p>\n\n\n\n<ul class=\"wp-block-list\">\n<li>Empiece por la p\u00e1gina de inicio para tener una visi\u00f3n completa:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/\">F\u00e1brica B2B de PCB en China: creaci\u00f3n r\u00e1pida de prototipos, montaje fiable<\/a><\/li>\n\n\n\n<li>Para construcciones controladas y planificaci\u00f3n de capas:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/capabilities\/\">Capacidades de PCB<\/a><\/li>\n\n\n\n<li>Para construcciones de placas de impedancia controlada y opciones de apilamiento:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/services\/advanced-pcb\/\">Servicios avanzados de PCB<\/a><\/li>\n\n\n\n<li>Para el \u00e1mbito de construcci\u00f3n en la fabricaci\u00f3n de placas desnudas:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/services\/pcb-fabrication\/\">Servicio de fabricaci\u00f3n de placas de circuito impreso<\/a><\/li>\n\n\n\n<li>Para construcciones llave en mano que requieran un montaje sencillo:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/services\/pcb-assembly\/\">Servicio de montaje de placas de circuito impreso<\/a><\/li>\n\n\n\n<li>Para puertas de calidad que importan en impedancia controlada:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/quality\/\">Control de calidad<\/a><\/li>\n\n\n\n<li>Para el encaje del proyecto y la evaluaci\u00f3n de proveedores:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/about-us\/\">Qui\u00e9nes somos<\/a><\/li>\n\n\n\n<li>Para consultas y traspaso de DFM:\u00a0<a href=\"https:\/\/mchdipcb-legacy-202609.10smt.com\/es\/contact-us\/\">P\u00f3ngase en contacto con nosotros<\/a><\/li>\n<\/ul>\n\n\n\n<p class=\"wp-block-paragraph\">Si quieres que esta pieza sea a\u00fan m\u00e1s \u201c\u00fatil para el taller\u201d, comparte un objetivo (por ejemplo: microstrip de un solo extremo de 50 \u03a9, o stripline diferencial de 100 \u03a9) m\u00e1s el n\u00famero de capas que prefieras. Puedo reescribir los escenarios para que coincidan con ese estilo exacto de apilamiento sin rellenar con texto de relleno.<\/p>","protected":false},"excerpt":{"rendered":"<p>Vea c\u00f3mo los apilamientos de PCB cambian la impedancia a altas frecuencias. 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